-- Copyright (C) 2018 Intel Corporation. All rights reserved. -- Your use of Intel Corporation's design tools, logic functions -- and other software and tools, and its AMPP partner logic -- functions, and any output files from any of the foregoing -- (including device programming or simulation files), and any -- associated documentation or information are expressly subject -- to the terms and conditions of the Intel Program License -- Subscription Agreement, the Intel Quartus Prime License Agreement, -- the Intel FPGA IP License Agreement, or other applicable license -- agreement, including, without limitation, that your use is for -- the sole purpose of programming logic devices manufactured by -- Intel and sold by Intel or its authorized distributors. Please -- refer to the applicable agreement for further details. -- -- This is a Quartus Prime output file. It is for reporting purposes only, and is -- not intended for use as a Quartus Prime input file. This file cannot be used -- to make Quartus Prime pin assignments - for instructions on how to make pin -- assignments, please see Quartus Prime help. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- NC : No Connect. This pin has no internal connection to the device. -- DNU : Do Not Use. This pin MUST NOT be connected. -- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V). -- VCCIO : Dedicated power pin, which MUST be connected to VCC -- of its bank. -- Bank 1: 3.3V -- Bank 2: 3.3V -- Bank 3: 3.3V -- Bank 4: 3.3V -- Bank 5: 3.3V -- Bank 6: 3.3V -- Bank 7: 3.3V -- Bank 8: 3.3V -- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND. -- It can also be used to report unused dedicated pins. The connection -- on the board for unused dedicated pins depends on whether this will -- be used in a future design. One example is device migration. When -- using device migration, refer to the device pin-tables. If it is a -- GND pin in the pin table or if it will not be used in a future design -- for another purpose the it MUST be connected to GND. If it is an unused -- dedicated pin, then it can be connected to a valid signal on the board -- (low, high, or toggling) if that signal is required for a different -- revision of the design. -- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins. -- This pin should be connected to GND. It may also be connected to a -- valid signal on the board (low, high, or toggling) if that signal -- is required for a different revision of the design. -- GND* : Unused I/O pin. Connect each pin marked GND* directly to GND -- or leave it unconnected. -- RESERVED : Unused I/O pin, which MUST be left unconnected. -- RESERVED_INPUT : Pin is tri-stated and should be connected to the board. -- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor. -- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry. -- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- Pin directions (input, output or bidir) are based on device operating in user mode. --------------------------------------------------------------------------------- Quartus Prime Version 18.0.0 Build 614 04/24/2018 SJ Lite Edition CHIP "GECKO" ASSIGNED TO AN: EP4CE30F23C8 Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment ------------------------------------------------------------------------------------------------------------- GND : A1 : gnd : : : : VCCIO8 : A2 : power : : 3.3V : 8 : row8[11] : A3 : output : 3.3-V LVTTL : : 8 : Y row5[11] : A4 : output : 3.3-V LVTTL : : 8 : Y row6[10] : A5 : output : 3.3-V LVTTL : : 8 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : A6 : : : : 8 : row7[9] : A7 : output : 3.3-V LVTTL : : 8 : Y row5[9] : A8 : output : 3.3-V LVTTL : : 8 : Y row7[8] : A9 : output : 3.3-V LVTTL : : 8 : Y row5[8] : A10 : output : 3.3-V LVTTL : : 8 : Y in_buttons[1] : A11 : input : 3.3-V LVTTL : : 8 : Y in_buttons[3] : A12 : input : 3.3-V LVTTL : : 7 : Y row8[7] : A13 : output : 3.3-V LVTTL : : 7 : Y row5[7] : A14 : output : 3.3-V LVTTL : : 7 : Y row8[6] : A15 : output : 3.3-V LVTTL : : 7 : Y row5[6] : A16 : output : 3.3-V LVTTL : : 7 : Y row8[5] : A17 : output : 3.3-V LVTTL : : 7 : Y row5[5] : A18 : output : 3.3-V LVTTL : : 7 : Y row8[4] : A19 : output : 3.3-V LVTTL : : 7 : Y row6[3] : A20 : output : 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